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电路设计

指数 电路设计

电路设计(circuit design),广义上是指对任何电路的设计(电子电路设计),而狭义上则主要指集成电路设计中寄存器传输级设计(即功能设计)和物理设计两大步骤之间,将逻辑综合产生的逻辑门级网表,转换到更低抽象级的晶体管级电路所经历的设计过程。为了表示这种情况与广义上电路设计的区别,工程师有时也将其称为晶体管级设计。.

7 关系: 寄存器传输级电子电路设计物理设计邏輯閘集成电路设计逻辑综合晶体管

寄存器传输级

在数位电路设计中,寄存器传输级(register-transfer level, RTL)是一种对同步数位电路的抽象模型,这种模型是根据数字信号在硬件寄存器、存储器、组合逻辑装置和总线等逻辑单元之间的流动,以及其逻辑代数运作方式来确定的。 寄存器传输级抽象模型在诸如Verilog和VHDL的硬件描述语言中被用于创建对实际电路的高层次描述,而低层次描述甚至实际电路可以通过高层次描述导出。在现代的数位设计中,寄存器传输级上的设计是最典型的工作流程。逻辑合成工具可以根据寄存器传输级的描述构建更低级别的电路描述。.

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电子电路设计

电子电路设计包括电子电路的分析与合成。.

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物理设计

在集成电路设计中,物理设计(physical design)是完成功能设计之后的一个流程。在这一步,经过布图规划、布局、布线等具体过程后,以硬件描述语言等抽象形式表达的电路网表会被转换成代表电路的几何图形,这个几何图形被称为集成电路版图。半导体工厂根据版图文件就可以制造出实际的硬件电路。除了前面提到的具体过程,物理设计还包括一系列对于版图的设计和验证。.

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邏輯閘

逻辑门是在集成電路上的基本組件。简单的邏輯閘可由晶体管组成。這些晶体管的组合可以使代表两种信号的高低电平在通过它们之后产生高电平或者低电平的信号。高、低电平可以分别代表逻辑上的“真”与“假”或二进制当中的1和0,从而实现邏輯运算。常见的逻辑门包括“與”閘,“或”閘,“非”閘,“異或”閘(也稱:互斥或)等等。 逻辑门是組成數字系統的基本結構,通常组合使用實現更為複雜的邏輯運算。一些廠商通過邏輯門的組合生產一些實用、小型、集成的產品,例如可程式邏輯裝置等。.

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集成电路设计

集成电路设计(Integrated circuit design, IC design),根据当前集成电路的集成规模,亦可称之为超大规模集成电路设计(VLSI design),是指以集成电路、超大规模集成电路为目标的设计流程。.

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逻辑综合

在集成电路设计中,邏輯合成(logic synthesis)是所设计数字电路的高抽象级描述,经过布尔函数化简、优化后,转换到的逻辑门级别的电路连线网表的过程。.

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晶体管

晶体管(transistor),早期音譯為穿細絲體,是一种-zh-cn:固体; zh-tw:固態;--zh-cn:半导体器件; zh-tw:半導體元件;-,可以用于放大、开关、稳压、信号调制和许多其他功能。在1947年,由約翰·巴丁、沃爾特·布喇頓和威廉·肖克利所發明。當時巴丁、布喇頓主要發明半導體三極體;肖克利則是發明PN二極體,他們因為半導體及電晶體效應的研究獲得1956年諾貝爾物理獎。 電晶體由半導體材料組成,至少有三個對外端點(稱為極),(C)集極、(E)射極、(B)基極,其中(B)基極是控制極,另外兩個端點之間的伏安特性關係是受到控制極的非線性電阻關係。晶体管基于输入的電流或电压,改變輸出端的阻抗 ,從而控制通過輸出端的电流,因此晶體管可以作為電流開關,而因為晶体管輸出信號的功率可以大於輸入信號的功率,因此晶体管可以作為电子放大器。.

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